chip programmabili di CI

Dettaglio rapido:

Regolatore di comunicazioni sincrono multicanale (MUSYCC)

Descrizione: 

I CN8478, i CN8474A, i CN8472A e i CN8471A sono controllori di trasmissione sincroni multicanali avanzati (MUSYCCs) quel formato e deformat fino a 256 (CN8478), 128 (CN8474A), 64 (CN8472A), o 32 (CN8471A) canali di HDLC in un singolo circuito integrato di CMOS. MUSYCC funziona allo strato 2 del modello di riferimento di protocollo di (OSI) di Open Systems Interconnection. MUSYCC fornisce il trasporto una soluzione per l'elaborazione dei canali di HDLC per le applicazioni di collegamento tra reti quale il frame relay, una segnalazione di D-Manica del ISDN, di dati completi e ad alta densità di X.25, del sistema di segnalazione 7 (SS7), di DXI, di ISUP e di LAN/WAN. Nell'ambito di controllo minimo ospite, MUSYCC dirige una lista collegata dei buffer del canale nella memoria ospite realizzando il Direct Memory Access (DMA) dei canali di HDLC.

MUSYCC collega mediante interfaccia ad otto flussi di dati di serie indipendenti, quale T1/E1 segnala e poi trasferisce i dati attraverso il bus popolare di (PCI) dell'interfaccia della componente periferica di 32 bit alla memoria di sistema ad un tasso di fino a 66 megahertz. Ogni interfaccia seriale può essere azionata a fino a 8,192 megahertz. I canali logici possono essere tracciati come tutta la combinazione di fasce orarie DS0 per sostenere i hyperchannels del ISDN (kilobits Nx64) o come qualsiasi numero di pezzi in un DS0 per le applicazioni subchanneling (kilobits Nx8).

MUSYCC inoltre include un porto di espansione di 32 bit per gettare un ponte sul bus del PCI ai microprocessori locali o alle unità periferiche. Un porto di JTAG permette alla prova di frontiera-ricerca di sostituire la prova del bordo dei letto-de-chiodi.

I driver per Linux, VxWorks® ed i sistemi operativi dello pSOS™ sono disponibili in virtù di un contratto di licenza della NO--tassa da Conexant. I driver comprendono i documenti di codice sorgente di C e del software di sostegno.

Applicazioni:

• 256-, 128-, 64-, o regolatore di 32-channel HDLC

• Supporto di protocollo di strato di OSI 2

• Uso generale HDLC (iso 3309)

– X.25 (LAPB)

– Frame relay (LAPF/ANSI T1.618)

– D-Manica del ISDN (LAPD/Q.921)

– Supporto SS7

• le interfacce seriali di 8, 4, 2, o 1 indipendente che sostengono

– Flussi di dati T1/E1

– CC a 8,192 bus di Mbps TDM

• Canali logici configurabili

– DS0 standard (56, 64 kilobits)

– Hyperchannel (Nx64)

– Canale secondario (Nx8)

• selezione modi di funzionamento di protocollo di Per-Manica

– modo di FCS di 16 bit

– modo di FCS di 32 bit

– SS7 modo (FCS di 16 bit)

– Modo trasparente (dati non formati)

• gestione di amplificatore di Per-Manica DMA

– Strutture di dati della lista collegata

– Trasmissione/ricevimento variabile FIFO di dimensione

• controllo di lunghezza di messaggio di Per-Manica

– Non selezioni controllo di lunghezza

– Scelga da due registri di 12 bit per confrontare la lunghezza di messaggio

– Lunghezza massima 16.384 byte

• Interfaccia bus diretta del PCI

– operazione di 32 bit, 66 o 33 di megahertz

– Operazione del padrone e dello schiavo del bus

– Versione 2,1 del PCI

• Interfaccia bus locale di espansione (EBUS)

– canale omnibus di dati multiplexato 32 bit/di indirizzo

– Accesso di scoppio fino a 64 byte

• Potere basso, un'operazione di 3.3/2.5 V CMOS

• Porto di accesso di ricerca di frontiera di JTAG

• pacchetto di 208-pin PQFP/surface-mount

• BGA

Specifiche:

Vantaggio competitivo:

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